Perteneciente al dominio de verificación funcional, puedo hablar de cuáles son los temas futuros en esta área.
Verificación formal: creo que la Verificación formal es realmente calurosa en estos días. Aunque el mercado es pequeño pero está creciendo a un ritmo rápido. También es un tema muy candente en la investigación también.
Simulación: la simulación paralela y la automatización inteligente del banco de pruebas son las pocas técnicas que se están investigando o produciendo. Si se perfecciona, esto también hará que el proceso de diseño del chip sea rápido y rentable.
Síntesis de alto nivel: C-to-Silicon es una de esas herramientas de Cadence Design Systems, Inc. Esta herramienta nos ayuda a escribir el diseño en lenguajes de alto nivel como C & C ++. Dichas herramientas y técnicas pueden verse más en el futuro.
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Híbrido: los ingenieros están trabajando duro para encontrar lo mejor de las tecnologías de ambos mundos. Se están realizando esfuerzos para crear una tecnología que pueda utilizar lo mejor de las tecnologías mencionadas anteriormente, como la simulación-emulación híbrida, la simulación-híbrida formal, etc.
Continuará …